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ADT7462
Table 4. ELECTRICAL CHARACTERISTICS (T A = T MIN to T MAX , V CC = V MIN to V MAX , unless otherwise noted.) (Note 1)
Parameter
Test Conditions/Comments
Min
Typ
Max
Unit
OPEN-DRAIN SERIAL BUS OUTPUT (SDA)
Output Low Voltage, V OL
High Level Output Leakage Current, I OH
I OUT = ? 3 mA, V CC = +3.3 V
V OUT = V CC
?
?
?
0.1
0.4
? 1.0
V
m A
SERIAL BUS DIGITAL INPUTS (SDA AN D SCL)
Input High Voltage, V IH
Input Low Voltage, V IL
Hysteresis
2.1
?
?
?
?
500
?
0.8
?
V
V
mV
DIGITAL INPUT LOGIC LEVELS (VID0 to VID6) AND THERM, TACH, GPIO, VR_HOT, SCSI_TERM)
Input High Voltage, V IH
Input Low Voltage, V IL
Input High Voltage, V IH (VID0 to VID6)
Input High Voltage, V IH (THERM)
Input Low Voltage, V IL
Hysteresis
Bit 3 and Bit 4 of Configuration Register 3 = 0
Bit 3 and Bit 4 of Configuration Register 3 = 0
Bit 3 of Configuration Register 3 = 1
Bit 4 of Configuration Register 3 = 1
Bit 3 and Bit 4 of Configuration Register 3 = 1
1.7
?
0.65
2/3 V CCP1
?
?
?
?
?
?
?
500
?
0.8
?
?
0.4
?
V
V
V
V
V
mV
DIGITAL INPUT CURRENTS
Input High Current, I IH
Input Low Current, I IL
Input Capacitance (Note 3)
V IN = V CC
V IN = 0
? 1.0
?
?
?
?
5.0
?
+1.0
?
m A
m A
pF
SERIAL BUS TIMING (Note 3)
Clock Frequency
Glitch Immunity, t SW
Bus Free Time
Start Setup Time, t SU;STA
Start Hold Time, t HD;STA
SCL Low Time, t LOW
SCL High Time, t HIGH
SCL, SDA Rise Time, t R
SCL, SDA Fall Time, t F
Data Setup Time, t SU;DAT
Detect Clock Low Timeout
See Figure 2
See Figure 2
See Figure 2
See Figure 2
See Figure 2
See Figure 2
See Figure 2
See Figure 2
See Figure 2
See Figure 2
Can Be Optionally Enabled
?
?
1.3
0.6
0.6
1.3
0.6
?
?
100
?
?
50
?
?
?
?
?
?
?
?
25
400
?
?
?
?
?
?
1000
300
?
?
kHz
ns
m s
m s
m s
m s
m s
ns
ns
ns
ms
1. All voltages are measured with respect to GND, unless otherwise specified. Typical values are at T A = 25 ? C and represent the most likely
parametric norm. Logic inputs accept input high voltages up to 5.0 V, even when the device is operating at supply voltages below 5.0 V. Timing
specifications are tested at logic levels of V IL = 0.8 V for a falling edge and V IH = 2.0 V for a rising edge.
2. Unused digital inputs connected to GND.
3. Guaranteed by design, not production tested.
4. Note that this specification does not apply if Pin 26 (V BATT , +1.2V) is being measured in single-channel mode. See Figure 16 in the Typical
Performance Characteristics section for V BATT accuracy.
5. For Pin 23 and Pin 24 configured as +1.8V or +2.5V only, restricted conditions of V CC ? 3.3 V and +25 ? C ? T A ? +125 ? C apply.
t LOW
t R
t F
t HD; STA
SCL
t HD; STA
t HD; DAT
t HIGH
t SU; DAT
t SU; STA
t SU; STO
SDA
t BUF
P
S
S
P
Figure 2. Serial Bus Timing Diagram
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6
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